XC3S50A Xilinx Corp., XC3S50A Datasheet - Page 81

• Manufacturer Part Number: XC3S50A
• Description: Spartan-3a Fpga Family Data Sheet
• Manufacturer: Xilinx Corp.

Table 68: Spartan-3A FG320 Pinout (Continued)
DS529-4 (v1.5) July 10, 2007
Product Specification
Bank
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2
2
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2
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2
2
2
2
2
2
2
2
3
3
3
3
3
3
IO_L14P_2/GCLK2
IO_L15N_2
IO_L15P_2
IO_L16N_2/MOSI/CSI_B
IO_L16P_2
IO_L17N_2
IO_L17P_2
IO_L18N_2/DOUT
IO_L18P_2/AWAKE
IO_L19N_2
IO_L19P_2
IO_L20N_2/D3
IO_L20P_2/INIT_B
IO_L21N_2
IO_L21P_2
IO_L22N_2/D1
IO_L22P_2/D2
IO_L23N_2
IO_L23P_2
IO_L24N_2/CCLK
IO_L24P_2/D0/DIN/MISO
IP_2
IP_2
IP_2
XC3S400A: IP_2
XC3S200A: N.C. (◆)
IP_2
IP_2
IP_2
IP_2/VREF_2
IP_2/VREF_2
IP_2/VREF_2
IP_2/VREF_2
IP_2/VREF_2
IP_2/VREF_2
XC3S400A: IP_2/VREF_2
XC3S200A: N.C. (◆)
VCCO_2
VCCO_2
VCCO_2
VCCO_2
IO_L01N_3
IO_L01P_3
IO_L02N_3
IO_L02P_3
IO_L03N_3
IO_L03P_3
R
Pin Name
FG320
M12
M11
Ball
V11
R10
P10
R11
V13
U12
U13
P12
N12
R13
V14
U15
V15
R14
U16
V16
N11
N10
P13
P14
U14
T11
T12
T13
T14
T15
P11
M8
M9
N7
N9
R6
P6
P7
P9
R8
U5
C1
C2
B1
B2
D2
D3
MGMT
INPUT
INPUT
INPUT
INPUT
INPUT
INPUT
INPUT
VCCO
VCCO
VCCO
VCCO
GCLK
VREF
VREF
VREF
DUAL
DUAL
DUAL
DUAL
DUAL
DUAL
DUAL
DUAL
VREF
VREF
VREF
VREF
Type
PWR
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
www.xilinx.com
Table 68: Spartan-3A FG320 Pinout (Continued)
Bank
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3
3
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3
3
3
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3
3
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3
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3
3
3
3
3
3
3
3
3
IO_L05N_3
IO_L05P_3
IO_L06N_3
IO_L06P_3
IO_L07N_3
IO_L07P_3
IO_L09N_3
IO_L09P_3
IO_L10N_3/VREF_3
IO_L10P_3
IO_L11N_3
IO_L11P_3
IO_L13N_3
IO_L13P_3
IO_L14N_3/LHCLK1
IO_L14P_3/LHCLK0
IO_L15N_3/IRDY2/LHCLK3
IO_L15P_3/LHCLK2
IO_L17N_3/LHCLK5
IO_L17P_3/LHCLK4
IO_L18N_3/LHCLK7
IO_L18P_3/TRDY2/LHCLK6
IO_L19N_3
IO_L19P_3/VREF_3
IO_L21N_3
IO_L21P_3
IO_L22N_3
IO_L22P_3
IO_L23N_3
IO_L23P_3
IO_L25N_3
IO_L25P_3
IO_L26N_3
IO_L26P_3
IO_L27N_3
IO_L27P_3
IO_L29N_3
IO_L29P_3
IO_L30N_3
IO_L30P_3
IO_L31N_3
IO_L31P_3
IP_L04N_3/VREF_3
IP_L04P_3
IP_L08N_3/VREF_3
IP_L08P_3
IP_L12N_3
Pin Name
Pinout Descriptions
FG320
Ball
G5
G4
M2
G6
G2
E3
E1
D1
H1
H2
H3
K5
K3
K2
N1
N2
P1
R2
R1
N4
N3
N6
N5
R3
P3
U2
U1
H7
H5
H6
F5
F4
F3
F1
F2
J6
J7
J3
J1
J2
J4
L2
L1
L4
L3
T2
T1
LHCLK
LHCLK
LHCLK
LHCLK
LHCLK
LHCLK
LHCLK
LHCLK
INPUT
INPUT
INPUT
VREF
VREF
VREF
VREF
Type
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
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