SC28L202A1DGG/G,11 NXP Semiconductors, SC28L202A1DGG/G,11 Datasheet - Page 3

• Manufacturer Part Number: SC28L202A1DGG/G,11
• Description: IC UART DUAL W/FIFO 56-TSSOP
• Manufacturer: NXP Semiconductors
• Series: IMPACTr

Specifications of SC28L202A1DGG/G,11

• Features: False-start Bit Detection
• Number Of Channels: 2, DUART
• Fifo's: 256 Byte
• Voltage - Supply: 3.3V, 5V
• With Parallel Port: Yes
• With Auto Flow Control: Yes
• With False Start Bit Detection: Yes
• With Modem Control: Yes
• With Cmos: Yes
• Mounting Type: Surface Mount
• Package / Case: 56-TFSOP (0.240", 6.10mm Width)
• Lead Free Status / RoHS Status: Lead free / RoHS Compliant
• Other names: 935279792118; SC28L202A1DGG/G-T; SC28L202A1DGG/G-T

Philips Semiconductors
2005 Nov 01
Dual universal asynchronous receiver/transmitter
(DUART)
Registers for Character Recognition
Programmable Counters, Timers and Baud Rate generators
MR3 – Mode Register 3, A and B
MR3[7 & 6] Xon/Xoff Character Stripping
MR3[5:4] Reserved
MR3[3:2] Xon/Xoff Processing
MR3[1:0] Address Recognition
RxCSR – Receiver Clock Select Register A and B
TxCSR Transmitter Clock Select Register A and B
Rx and Tx Clock Select Table
CRx – Command Register Extension, A and B
CR[7] – Lock Tx and Rx enables.
CR[6] – Enable Transmitter
CR[5] – Enable Receiver
CR[4:0] – Miscellaneous Commands (See Table below)
COMMAND REGISTER EXTENSION TABLE A and B
SR – Channel Status Register A and B
SR[7] – Received Break
SR[6] – Framing Error (FE)
SR[5] – Parity Error (PE)
SR[4] – Overrun Error (OE)
SR [3] – Transmitter Idle (Tx Idle)
SR[2] – Transmitter Ready (TxRDY)
SR[1] – RxFIFO Full (RxFULL)
SR[0] – Receiver Ready (RxRDY)
ISR – Interrupt Status Register A and B
ISR[7] – Input Change of State.
ISR[6] Fixed Watchdog Time-out.
ISR[5] – Address Recognition Status Change.
ISR[4] – Xon/Xoff Status Change.
ISR[3] – Counter Timer Status
ISR[2] – Change in Channel Break Status.
ISR[1] – RxINT. (Also Rx DMA hand shake at I/O pins)
ISR[0] – TxINT. (Also Tx DMA hand shake at I/O pins)
IMR – Interrupt Mask Register A and B
IMR[7] COS enable
IMR[6] Fixed Watchdog Enable
IMR[5] Address recognition enable
IMR[4] Xon/Xoff Enable
IMR[3] Counter/Timer Enable
IMR[1] Receiver (Rx) Enable
IMR[0] Transmitter (Tx) Enable
RxFIFO – Receiver FIFO, A and B
TxFIFO – Transmitter FIFO, A and B
RxFIL – Receiver FIFO Interrupt Level, A and B
RxFL – Receiver FIFO Fill Level Register
TxFIL – Transmitter FIFO Interrupt Level A and B
TxEL – Transmitter FIFO Empty Level Register
XonCR – Xon/Xoff Character Register A and B
XoffCR – Xoff Character Register A and B
ARCR – Address Recognition Character Register A and B
XISR – Xon–Xoff Interrupt Status Register A and B (Reading this register clears XISR(7:4))
XISR[7:6] Received X Character Status.
XISR[5:4] Automatic transmission Status.
XISR[3:2] TxD Condition of the automatic flow control status.
XISR[1:0] TxD X character Status.
WCXER Watch Dog, Character, Address and X Enable Register – A and B
PBRGPU – Programmable BRG Timer Reload Registers, Upper 0 and 1
PBRGPL – Programmable BRG Timer Reload Registers, Lower 0 and 1
CTCS 0 and 1 – Counter Timer clock source
CTVU – Counter Timer Value Registers, Upper 0 and 1
CTVL – Counter timer Value Registers, Lower 0 and 1
PBRGCS – Programmable BRG Clock Source
CTPU Counter Timer Preset Upper 0 and 1
CTPL Counter –Timer Preset Low 0 and 1
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SC28L202
Product data sheet
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