PDI1394L40BE,551 NXP Semiconductors, PDI1394L40BE,551 Datasheet - Page 3

• Manufacturer Part Number: PDI1394L40BE,551
• Manufacturer: NXP Semiconductors

Specifications of PDI1394L40BE,551

• Lead Free Status / Rohs Status: Compliant

Philips Semiconductors
1.0 FEATURES
2.0 DESCRIPTION
3.0 QUICK REFERENCE DATA
4.0 ORDERING INFORMATION
5.0 PIN CONFIGURATION
6.0 FUNCTIONAL DIAGRAM
7.0 INTERNAL BLOCK DIAGRAM
8.0 APPLICATION DIAGRAM
9.0 PIN DESCRIPTION
10.0 RECOMMENDED OPERATING CONDITIONS
11.0 ABSOLUTE MAXIMUM RATINGS
12.0 FUNCTIONAL DESCRIPTION
13.0 REGISTER MAP
2000 Dec 15
1394 enhanced AV link layer controller
9.1 Host Interface
9.2 AV Interface 1
9.3 AV Interface 2
9.4 Phy Interface
9.5 Other Pins
12.1 Overview
12.2 AV interface and AV layer
12.3 Bushold and Link/PHY single capacitor galvanic isolation
12.4 Power Management
12.5 The host interface
12.6 The Asynchronous Packet Interface
12.7 Interrupts
13.1 Link Control Registers
13.2 AV (Isochronous) Transmitter and Receiver Registers
12.2.1 IEC 61883 International Standard
12.2.2 CIP Headers
12.2.3 The AV Interface
12.2.4 Audio Support
12.2.5 SY – Sync Support
12.2.6 Programmable Buffer Memory
12.3.1 Bushold
12.3.2 Single capacitor isolation
12.5.1 Read accesses
12.5.2 Write accesses
12.5.3 Accessing the RDI register (Power–down, Power–up)
12.5.4 Big and little endianness, data invariance, and data bus width
12.5.5 Accessing the asynchronous packet queues
12.5.6 The CPU bus interface signals
12.6.1 Reading an Asynchronous Packet
12.6.2 Link Packet Data Formats
13.1.1 ID Register (IDREG) – Base Address: 0x000
13.1.2 General Link Control (LNKCTL) – Base Address: 0x004
13.1.3 Link /Phy Interrupt Acknowledge (LNKPHYINTACK) – Base Address: 0x008
13.1.4 Link / Phy Interrupt Enable (LNKPHYINTE) – Base Address: 0x00C
13.1.5 Cycle Timer Register (CYCTM) – Base Address: 0x010
13.1.6 Phy Register Access (PHYACS) – Base Address: 0x014
13.1.7 Global Interrupt Status and TX Control (GLOBCSR) – Base Address: 0x018
13.1.8 Timer (TIMER) – Base Address: 0x01C
13.2.1 Isochronous Transmit Packing Control and Status (ITXPKCTL) – Base Address: 0x020
13.2.2 Common Isochronous Transmit Packet Header Quadlet 1 (ITXHQ1) – Base Address: 0x024
13.2.3 Common Isochronous Transmit Packet Header Quadlet 2 (ITXHQ2) – Base Address: 0x028
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PDI1394L40
Preliminary specification
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12
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14
15
16
17
25
25
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39
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52
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3
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4
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7
7
8
8
9
9
9
9
9
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