FMS7401LVN14 Fairchild Semiconductor, FMS7401LVN14 Datasheet - Page 7

• Manufacturer Part Number: FMS7401LVN14
• Description: IC CTRLR POWER DGTL EEPROM 14DIP
• Manufacturer: Fairchild Semiconductor

Specifications of FMS7401LVN14

• Applications: Digital Power Controller
• Core Processor: 8-Bit
• Program Memory Type: EEPROM (1 kB)
• Ram Size: 64 x 8
• Number Of I /o: 8
• Voltage - Supply: 2.7 V ~ 3.6 V
• Operating Temperature: -40°C ~ 125°C
• Mounting Type: Through Hole
• Package / Case: 14-DIP (0.300", 7.62mm)
• Output Current: 5 mA
• Input Voltage: 2.7 V to 3.6 V
• Switching Frequency: 2 MHz
• Operating Temperature Range: - 40 C to + 125 C
• Mounting Style: Through Hole
• Lead Free Status / RoHS Status: Lead free / RoHS Compliant
• Interface: -
• Controller Series: -
• Lead Free Status / Rohs Status: Lead free / RoHS Compliant
• Other names: FMS7401LVN14_NL; FMS7401LVN14_NL

List of Tables
Table 1.
Table 2.
Table 3.
Table 4.
Table 5.
Table 6.
Table 7.
Table 8.
Table 9.
Table 10.
Table 11.
Table 12.
Table 13.
Table 14.
Table 15.
Table 16.
Table 17.
Table 18.
Table 19.
Table 20.
Table 21.
Table 22.
Table 23.
Table 24.
Table 25.
Table 26.
Table 27.
Table 28.
Table 29.
Table 30.
Table 31.
Table 32.
Table 33.
REV. 1.0.3 1/24/05
PRODUCT SPECIFICATION
Default Register States
CMODE Bit Definition
PLL Frequency Selection (F
HALT Register Definition
ADCNTRL1 Register Bit Definitions
Analog Input Channel Selection (ACHSEL[3:0]) Bit Definitions
ADCNTRL2 Register Bit Definitions
Programmable Comparator (COMP) Control Register Bit Definitions
Programmable Comparator Lower Voltage Reference V
Programmable Comparator Upper Voltage Reference V
Digital Delay (DDELAY) Register Bit Definitions
Prescale (PSCALE) Register Bit Definitions
PLL Divide Factor Selection Bits and the F
Timer 1 Prescale Selection (PS) Bits
Dead Time (DTIME) Register Bit Definitions
Timer 1 Control (T1CNTRL) Register Bit Definitions
Timer 1 Mode Configuration Bits
Timer 0 Control (T0CNTRL) Register Definitions
Watchdog Service Register (WDSVR) Definition
I/O Register Bit Assignments
I/O Configuration Options
Multi-input Wakeup (MIW) Register Bit Assignments
Interrupt Priority Sequence
Instruction Addressing Modes
Instruction Cycles and Bytes
Initialization Register 1 Bit Definitions
Initialization Register 3 Bit Definitions
Initialization Register 4 Bit Definitions
T1HS1 (G0) and T1HS2 (G5) Default Configuration
Memory Mapped Registers
Memory Mapped Registers and their Register Bit Definitions
Programming Interface Electrical Characteristics
32-Bit Command and Response Word
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PLL
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/F
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OSC
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= 2MHz)
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T1CLK
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Resolution (F
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. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 56
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 37
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 45
THU
THL
(Levels 1 – 31)
(Levels 32 – 63)
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 58
OSC
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19
=2 MHz)
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. . . . . . . . . . . . . . . . . . . . . . . . . . . . 27
. . . . . . . . . . . . . . . . . . . . . . . . . . . . 33
. . . . . . . . . . . . . . . . . . . . . . . . . . . 28
FMS7401L
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