m470l2923bn0-ca2 Samsung Semiconductor, Inc., m470l2923bn0-ca2 Datasheet - Page 8

m470l2923bn0-ca2

Manufacturer Part Number

m470l2923bn0-ca2

Description

Sdram Unbuffered Module Unbuffered Module Based 512mb B-die

Manufacturer

Samsung Semiconductor, Inc.

Datasheet

1.M470L2923BN0-CA2.pdf (20 pages)

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256MB, 512MB, 1GB Unbuffered SODIMM

6.3 1GB, 128M x 64 Non ECC Module (M470L2923BN(V)0)

(Populated as 2 bank of x8 DDR SDRAM Module)

DM1

DQS1

DM3

DQS0

DM0

DQS2

DM2

DQS3

BA0 - BA1

A0 - A12

CKE1

CKE0

RAS

CAS

VREF

DDSPD

DDQ

DQ0

DQ1

DQ2

DQ3

DQ8

DQ9

DQ10

DQ11

DQ16

DQ17

DQ18

DQ19

DQ20

DQ21

DQ22

DQ23

DQ24

DQ25

DQ26

DQ27

DQ28

DQ29

DQ30

DQ31

DQ4

DQ5

DQ6

DQ7

DQ12

DQ13

DQ14

DQ15

CS0

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

BA0-BA1: DDR SDRAMs D0 - D15

A0-A12 : DDR SDRAMs D0 - D15

RAS

CAS

CKE

: DDR SDRAMs D0 - D15

: DDR SDRAMs D8 - D15

: DDR SDRAMs D0 - D7

: DDR SDRAMs D0 - D15

DQS

D0 - D15

SPD

CS1

I/O 4

I/O 5

I/O 6

I/O 7

I/O 4

I/O 5

I/O 6

I/O 7

I/O 0

I/O 1

I/O 2

I/O 3

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

I/O 0

I/O 1

I/O 2

I/O 3

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

D10

D11

DQS

DQS4

DM4

DQS5

DM5

DQS6

DM6

DM7

DQS7

CK0 / 1

Notes :

1. DQ-to-I/O wiring is shown as recommended but may be changed.

2. DQ/DQS/DM/CKE/CS relationships must be maintained as shown

3. DQ, DQS, DM/DQS resistors: 22 Ohm.

R=120

Card

Edge

DQ48

DQ49

DQ50

DQ51

DQ32

DQ33

DQ34

DQ35

DQ36

DQ37

DQ38

DQ39

DQ40

DQ41

DQ42

DQ43

DQ44

DQ45

DQ46

DQ47

DQ52

DQ53

DQ54

DQ55

DQ56

DQ57

DQ58

DQ59

DQ60

DQ61

DQ62

DQ63

Ω

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

D0,D8 / D4,D12

D1,D9 / D5,D13

D2,D10/ D6,D14

D3,D11/ D7,D15

*Clock Net Wiring

DQS

Rev. 1.5 June 2005

CK2

DDR SDRAM

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

I/O 0

I/O 1

I/O 2

I/O 3

I/O 4

I/O 5

I/O 6

I/O 7

D12

D13

D14

D15

10pF

DQS

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