qt1100a Quantum Research Group, qt1100a Datasheet - Page 2

• Manufacturer Part Number: qt1100a
• Description: 10 Key Qtouch? Sensor Ic
• Manufacturer: Quantum Research Group

LQ
1 Overview
2 Device Control & Wiring
3 Serial Operation
Contents
Table 1.1 Scanport / UART Pinlist
Table 1.2 Standalone Pinlist
Table 1.3 Standalone Pinlist
Table 1.4 SPI Pinlist
Table 1.5 Pin Descriptions
Figure 1.1 SPI Connection Diagram
Figure 1.2 UART / Scanport Connection Diagram
Figure 1.3 Scanport Only Connection Diagram+
2.1 Oscillator
2.2 Spread Spectrum Modulation
2.3 Cs Sample Capacitors
2.4 Sensitivity
2.5 Sensitivity Balance
2.6 Power Supply
2.7 PCB Layout and Construction
2.8 ESD Protection
2.9 Noise Issues
2.10 Start-up Time
2.11 Operating Parameter Setups
2.12 Standalone Operation, No EEPROM
2.13 EEPROM Functionality
2.14 Scanport Interface
2.15 Start-up Sequencing
2.16 Error Detection and Reporting
3.1 UART Interface
3.2 SPI Operation
3.3 Communication Error Handling
3.4 Control Commands
3.5 Status Commands
2.9.1 LED Traces and Other Switching Signals
2.9.2 External Fields
3.1.1 TX Pin
3.1.2 Sleep/Wake Operation in UART Mode
3.1.3 CRDY Operation in UART Mode
3.2.1 Multi-Drop SPI Capability
3.2.2 Sleep/Wake Operation in SPI Mode
3.2.3 CRDY Operation in SPI Mode
3.4.1 Null Command - 0x00
3.4.2 Enter Setups Load Mode - 0x01
3.4.3 Enter Run Mode - 0x02
3.4.4 Enter Cal Mode - 0x03
3.4.5 Force Reset - 0x04
3.4.6 Sleep - 0x05
3.4.7 Cal Key ‘k’ - 0x1k
3.5.1 Signal for 1 Key - 0x2k
3.5.2 Reference for Key ‘k’ - 0x4k
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4 Setup Block Functions
5 - Specifications
6 Appendix A - 8-Bit CRC C Algorithm
3.6 Command Sequencing
Figure 3-1 Suggested Serial Flow
Table 3-1 Control Commands
Table 3-2 Status Commands
4.1 NTHR - Negative Threshold Bits
4.2 NHYS - Negative Hysteresis Bits
4.3 NDCR / PDCR - Drift Comp Bits
4.4 NRD - Negative Recal Delay Bits
4.5 PRD - Positive Recal Delay Bits
4.6 AKS - Adjacent Key Suppression Bits
4.7 EK - Error Key Control Bits
4.8 K2L / LEDP / KEYO Control Bits
4.9 NDIL, FDIL - Detect Integrator Bits
4.10 PTHR - Positive Threshold Bits
4.11 PHYS - Positive Hysteresis Bits
4.12 SE, SYNC Control Bits
4.13 LBLL - Lower Burst Length Limit
4.14 BS - Burst Spacing Control Bits
4.15 BR - Baud Rate Control Bits
4.16 HCRC - Host CRC
Table 4-1 Serial / EEPROM Setups Block
4.17 Timing Tables
5.1 Absolute Maximum Specifications
5.2 Recommended Operating Conditions
5.3 AC Specifications
5.4 DC Specifications
5.5 Burst / Sync Timing
5.6 SPI Timing Diagram
5.7 QT1100A Timing Parameters - with Fosc = 12MHz
5.8 Current vs Vdd
5.9 Mechanical
5.10 Marking
3.5.3 Detect Integrator for Key ‘k’ - 0x6k
3.5.4 Status for Key ‘k’ - 0x8k
3.5.5 Report 1st Key - 0xC0
3.5.6 Report All Keys - 0xC1
3.5.7 Device Status - 0xC2
3.5.8 EEPROM CRC - 0xC3
3.5.9 RAM CRC - 0xC4
3.5.10 Error Flags for Group - 0xC5
3.5.11 Internal Code - 0xC6
3.5.12 Return Last Command - 0xC7
3.5.13 Dump Setups Block - 0xC8
3.5.14 Quick Report First Key - 0xC9
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Copyright © 2003-2005 QRG Ltd
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QT1100A-ISG R3.02/1105
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