FPDK05SR8004PSV FDK CORPORATION, FPDK05SR8004PSV Datasheet - Page 5
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FPDK05SR8004PSV
Manufacturer Part Number
FPDK05SR8004PSV
Description
3.0-5.5vdc Input, 4a, 0.8-3.465vdc Output
Manufacturer
FDK CORPORATION
Datasheet
1.FPDK05SR8004PSV.pdf
(12 pages)
FPDK05SR8004PSV
3.0-5.5Vdc Input, 4A, 0.8-3.465Vdc Output
Operation
Input and Output Impedance
The
connected to a DC power source using a low
impedance input line. In order to counteract the
possible effect of input line inductance on the stability
of the converter, the use of decoupling capacitors
placed in close proximity to the converter input pins is
recommended. This will ensure stability of the
converter and reduce input ripple voltage. Although
low ESR Tantalum or other capacitors should
typically be adequate, very low ESR capacitors
(ceramic, over 47µF) are recommended to minimize
input ripple voltage. The converter itself has on-board
internal input capacitance of 6uF with very low ESR
(ceramic).
FPDK05SR8004PSVと入力電源間は低インピーダンスで接続してください。
コンバータの安定性に影響のある入力インダクタンスを抑えるため、コンバータの
入力ピンの近傍にデカップリングコンデンサを付加することをお勧めします。こ
れによりコンバータの安定動作を確実にし、入力リップル電圧を抑制します。
低ESRタンタル、又はその他のコンデンサも一般的には問題ありませんが、
入力リップルを最小にするためには、非常に低ESRコンデンサ(セラミックで47μ
F以上)を推奨します。コンバータ自身は入力回路に極低ESRの6uFセラミック
入力コンデンサを搭載しています。
The FPDK05SR8004PSV is capable of stable
operation with no external capacitance on the output.
To minimize output ripple voltage, the use of very low
ESR ceramic capacitors is recommended. These
capacitors should be placed in close proximity to the
load to improve transient performance and to
decrease output voltage ripple.
FPDK05SR8004PSVは出力に外付けコンデンサが無い状態でも安定して
動作します。出力リップルを最小にするため、極低ESRのセラミックコンデンサの
接続を推奨します。過渡時の特性向上と出力リップル低減のために負荷
の近傍に極低ESRセラミックコンデンサを実装することをお勧めします。
Note that the converter does not have a SENSE pin
to counteract voltage drops between the output pins
and the load. The impedance of the line from the
converter output to the load should thus be kept as
low as possible to maintain good load regulation.
このコンバータは出力端子と負荷間の電圧ドロップを補正するセンス端子を設
けていません。精度の高い負荷特性を保持するために、コンバータの出力
から負荷までのラインインピーダンスは可能な限り低くしてください。
REMOTE (Pin 3)
The REMOTE pin (Pin 3) can be used to turn the
converter on or off remotely using a signal that is
referenced to GND (Pin 2 or 7). A typical
configuration for remote ON/OFF is shown in Fig. A.
リモート端子(3番ピン)はGND(2又は7番ピン)を基準としたリモート信号によりコ
ンバータをON/OFFするのに使用できます。一般的なリモートON/OFF回路
を図-Aに示します。
http://www.fdk.com
FPDK05SR8004PSV
Delivering Next Generation Technology
converter
should
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be
The
REMOTE pin is at logic high (open) and turns off
when it is at logic low. When the REMOTE pin is left
open, the converter is on. Voltage ranges for logic
high/low are provided in the Electrical Specifications
section.
FPDK05SR8004PSVはリモート端子が論理的にHigh (open)で動作し、論
理的にLowで停止します。 リモート端子が未接続 (オープン)の場合、コンバー
タはONします。 論理的High/Lowの電圧範囲は電気的特性を参照して
ください。
The REMOTE pin (pin3) is internally pulled-up to Vin.
An open collector (open -drain) transistor can be
used to drive the REMOTE pin (pin3).
The device driving the REMOTE pin (pin3) must be
capable of sinking up to 0.3mA at low logic level.
リモート端子(3番ピン)はモジュール内部でVinにプルアップされています。リモート
端子(3番ピン)の操作にはオープンコレクタ(オープンドレイン)のトランジスタが使用
可能です。
リモート端子(3番ピン)を操作するデバイスにはLowレベルで0.3mAのシンク能力
が必要です。
Power Good (Pin 6)
The Power Good Signal is an open-drain output that
asserts low when Vout is out of regulation.
パワーグッド信号はオープンドレイン出力で、出力電圧が確定していない状態
ではLowとなります。
Control signal
Fig. A: A typical configuration for remote ON/OFF
FPDK05SR8004PSV
GND
Preliminary Data Sheet
turns
Ver 1.1 May.26, 2010
REMOTE
GND
on
when
Series
the